基于负电容电路的高速列总线读出方法

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基于负电容电路的高速列总线读出方法

学术论文 | 更新时间：2025-07-24

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- 基于负电容电路的高速列总线读出方法
- High-Speed Column Bus Readout Method Based on Negative Capacitance Circuit
- 许睿明，郭仲杰，刘绥阳，余宁梅
- 电子学报 2025年53卷第4期页码：1192-1200
- 作者机构：
  西安理工大学自动化与信息工程学院，陕西西安 710048
- 作者简介：
  许睿明男，1997年2月出生于内蒙古巴彦淖尔.现为西安理工大学自动化与信息工程学院硕士研究生.主要研究方向为超大规模集成电路设计.E-mail: rmxu@stu.xaut.edu.cn
  郭仲杰男，1982年1月出生于陕西韩城.现为西安理工大学自动化与信息工程学院教授.主要研究方向为超大规模数模混合集成电路的设计.E-mail: zjguo@xaut.edu.cn
  刘绥阳女，1997年8月出生于陕西咸阳.现为西安理工大学自动化与信息工程学院博士研究生.主要研究方向为超大规模数模混合集成电路的设计.E-mail: syliu@stu.xaut.edu.cn
  余宁梅女，1963年1月出生于广东梅州.现为西安理工大学自动化与信息工程学院教授.主要研究方向为大规模集成电路设计与工艺.E-mail: yunm@xaut.edu.cn
- 基金信息：
  国家自然科学基金(62171367);陕西省创新能力支撑计划项目(2022TD-39)
- DOI： 10.12263/DZXB.20240948
  中图分类号：
- 修回：2025-04-17 ，
- 稿件说明：
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