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一种应用于阵列TDC的低抖动锁相环设计
一种应用于阵列TDC的低抖动锁相环设计
Design of a Low Jitter Phase Locked Loop for Array TDC
- 电子学报 2020年48卷第9期 页码：1703-1710
DOI： 10.3969/j.issn.0372-2112.2020.09.006
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